для обеспечения 16-разрядных данных задатчика шины. Плата расширения должна
обеспечить третье состояние на линиях D<15...08>, так как эти линии приводятся в
действие устройством обмена байтами на основной плате.
Более полная информация приводится в разделе 6.4.
ВНИМАНИЕ!
Когда некоторые платы расширения являются задатчиками шины, они игнорируют
сигналы IOCHRDY или SRDY* и выполняют стандартный цикл 8- или 16-разрядной
памяти. Любая плата расширения,которая возвращает сигналы IOCHRDY или SRDY* на
плату расширения, как это делается с основным ЦП, должна определить, может ли
плата расширения-задатчик шины поддерживать эти линии.
В табл. 5.1 и 5.3 показаны источники сигналов линий, которые являются
запускающими или принимающими, когда плата расширения находится в режиме
обращения к памяти или вводу/выводу и главный ЦП или другая плата расширения
(отмеченная как ADDX) являются задатчиком шины соответственно. Они определяют
также тип драйвера.
Режим сброса
Плата расширения входит в режим сброса всякий раз, когда разрешен RSTDEV,
независимо от того, в каком другом режиме она находилась. Все сигналы с тремя
состояниями шины платы расширения установиться в третье состояние, и все сигналы
с открытым коллектором должны быть отключены в течение 500 нсек длительности
разрешенного RSTDEV. Плата должна завершить инициализацию в течение 1 мсек
длительности разрешенного сигнала RSTDEV и быть готовой к нормальной работе
шины. Нормальная работа шины начинается немедленно после отключения сигнала
линии RSTDEV.
5.4 КОНТРОЛЛЕР РЕГЕНЕРАЦИИ
Контроллер регенерации выполняет цикл чтения по специальному адресу для
регенерации динамического ОЗУ основной платы или плат расширения. Каждые 15
мксек контроллер регенерации пытается захватить шину для выполнения цикла
регенерации. Если задатчиком шины в данный момент является основной ЦП, то
владение шиной передается контроллеру регенерации. Если плата расширения в
данный момент является задатчиком шины, то контроллер регенерации будет
выполнять цикл регенерации только если плата расширения разрешает линию MЕMREF*.
Если контроллер ПДП является задатчиком шины, то до передачи контроллером ПДП
управления шиной никакие циклы регенерации не могут быть выполнены.
Когда выполняется цикл регенерации, контроллер регенерации приводит в действие
линии адреса А<07...00> с одним из 256 адресов регенерации. Другие линии адреса
неопределены и должны устанавливаться в третье состояние источниками, которые
могут возбуждать их. Цикл представляет собой цикл доступа нормального типа или
типа готовности при разрешенных MEMR* и MRDC*.
ВНИМАНИЕ!
Цикл регенерации должен выполняться каждые 15 мксек для доступа ко всем адресам
динамического ОЗУ каждые 4 мсек. Если это не происходит, данные в ОЗУ могут быть
потеряны.
В табл. 5.4.1 и 5.4.2 показаны источники сигналов линий, которые являются
запускающими или принимающими для цикла регенерации, когда контроллер
регенерации или плата расширения является владельцем шины соответственно. Они
определяют также тип драйвера.
Примечание к табл. 5.4.1.: основной ЦП = PRI, плата расширения = ADD, контроллер
ПДП = DMA, контроллер регенерации = REF, память основной платы = MEM, ввод/вывод
основной платы =IO, TTL = = К1533 или К555, OC - открытый коллектор и TRI -
приемники/передатчики с тремя состояниями.
"-" указывает на то, что соответствующая линия не разрешена или не
контроллируется источником.
"x"-игнорируется. Источник может разрешить сигнал, но он будет игнорироваться
другими источниками. _
(1) DRQ# может быть запущен, но не воспримется, пока контроллер ПДП является
задатчиком шины.
(2) Принят основным ЦП через контроллер прерываний и задействуется по усмотрению
основного процессора, когда он является задатчиком шины.
(3) Этот сигнал должен контроллироваться постоянно и при разрешении немедленно
восприниматься.
(4) Всегда принимается устройством обмена байтами данных.
(5) Приводится в действие источниками основной платы, если адрес находится в
первом Mбайте адресного пространства и есть сигнал или MRDC* или MWTC*.
(6) Запускаются на разрешеный уровень аппаратными средствами основной платы на
весь цикл.
Примечание к табл. 5.4.2.: основной ЦП = PRI, плата расширения = ADD, контроллер
ПДП = DMA, контроллер регенерации = REF, память основной платы = MEM, ввод/вывод
основной платы =IO, TTL = = К1533 или К555, OC - открытый коллектор и TRI -
приемники/передатчикис тремя состояниями.
"-" указывает на то, что соответствующая линия не разрешена или не
контроллируется источником.
"x"-игнорируется. Источник может разрешить сигнал, но он будет игнорироваться
другими источниками.
(1) DRQ# может быть запущен, но не воспримется, пока контроллер ПДП является
задатчиком шины.
(2) Принят основным ЦП через контроллер прерываний и задействуется по усмотрению
основного процессора, когда он является задатчиком шины.
(3) Этот сигнал должен контроллироваться постоянно и при разрешении немедленно
восприниматься.
(4) Всегда принимается устройством обмена байтами данных.
(5) Приводится в действие источниками основной платы, если адрес находится в
первом Mбайте адресного пространства и есть сигнал или MRDC* или MWTC*.
(6) Запускаются на разрешеный уровень аппаратными средствами основной платы на
весь цикл.
Разрешается платой расширения, которая является задатчиком шины.
ПАРАМЕТРЫ УСТРОЙСТВА, НЕ ЯВЛЯЮЩЕГОСЯ ЗАДАТЧИКОМ ШИНЫ
Шина ISA фирмы INTEL имеет несколько особенных параметров, которые не зависят от
владения шиной.
6.1 АДРЕСНОЕ ПРОСТРАНСТВО ПАМЯТИ
Максимальное адресное пространство памяти, поддерживаемое шиной ISA, - 16 Мбайт
(24 адресные шины), однако не все места для плат расширения, могут поддерживать
все адресное пространство. Когда задатчик обращается к памяти основной платы или
платы расширения, он должен разрешить MRDC* или MWTC*; технические средства
основной платы, в свою очередь, разрешают линии MEMR* или MEMW* при доступе к
первым 1 Мбайтам. К месту [8] подключаются только линии MEMR*, MEMW*, D<07...00>
и A<19...00>; таким образом, ресурсы места [8] могут иметь длину данных только 8
бит и постоянно находиться в первых 1 Мбайтах адресного пространства
запоминающего устройства (ЗУ). Места для для плат расширения [8/16] принимают
все линии команд, адресов и данных; следовательно, эти ресурсы могут
соответствовать ресурсам данных 8 или 16 битов в любом месте адресного
пространства памяти. Доступ будет выполняться как 16-битовый цикл, если
разрешена MCS16*.
ПРИМЕЧАНИЕ
Способность памяти основной платы или платы расширения работать как ресурс
16-битовой памяти требует разрешения MCS16*. Формирование MCS16* основано на
декодировании LA <23...17>; таким образом, длина данных каждого блока из 128
кбайтов в адресных границах 128 кбайт должна быть всегда 8 или 16 битов.
Различные части каждого блока 128 кбайтов не могут быть разной длины данных,
поскольку это потребовало бы декодирования других адресных линий для генерации
MCS16*.
ВНИМАНИЕ!
Динамическое ОЗУ вместе с другими ресурсами шины требует цикла регенерации. Если
операция регенерации не выполняется каждые 15 мксек, то может произойти потеря
данных.
ОСНОВЫ ПРОЕКТИРОВАНИЯ ПЛАТ РАСШИРЕНИЯ.
Ресурс памяти на основной плате представляет собой пространство двух типов:
динамического ОЗУ (DRAM) и стираемого постоянного ЗУ (EPROM). DRAM имеет длинну
16 или 32 информационных бит в зависимости от разрядности данных главного CPU
(центрального процессора); но всегда по отношению к плате расширения выступает
как ресурс данных 16 бит. EPROM содержит BIOS и всегда 16-битовое.
Информацию о распределении памяти смотри в " Техническом справочнике INTEL ISA
на базе основной платы". Рекомендуется тщательно изучить принципы операций ЗУ,
прежде чем приступить к проектированию платы расширения. _
6.2 АДРЕСНОЕ ПРОСТРАНСТВО УСТРОЙСТВ ВВОДА/ВЫВОДА.
Максимальное адресное пространство ввода/вывода, поддерживаемое шиной ISA,
составляет 64 кбайта (16 адресных линий). Все места поддерживают 16 адресных
линий. Первые 256 байтов резервируются для ресурсов основной платы: регистров
контроллера прерываний и контроллеров прямого доступа к памяти,
таймера/счетчика, часов реального времени и других элементов для совместимости с
AT. Остальное адресное пространство ввода/вывода выбирает ресурсы на шине ISA.
См. информацию о распределении адресного пространства устройства ввода/вывода в
"Техническом справочнике INTEL ISA на основной плате".
ОСНОВЫ ПРОЕКТИРОВАНИЯ ПЛАТ РАСШИРЕНИЯ.
Даже несмотря на то, что существует 16 адресных линий, традиционно платами
расширения декодировались только первые 10 адресных шин для доступа к внешнему
устроруйству. Это приводит к тому. что 1-килобайтовый блок по отношению к
1-килобайтовой адресной границе становится повтором первого 1-килобайтового
блока. Следовательно, первые 256 байтов, которые занимают совместимые с XT/AT
ресурсы основной платы, повторяются в начале каждой 1-килобайтовой адресной
границы. Ресурсы платы расширения не должны пользоваться этой частью
1-килобайтовых блоков.
Если все платы расширения, подключенные к основной плате, и сама основная плата
декодирует все 16 адресные линии, то первый 1-килобайтовый блок не будет
повторяться по всему адресному пространству. Совместимые с XT/AT ресурсы в этом
случае храняться только в первых 256 байтах первого 1 килобайта.
6.3 СТРУКТУРА ПРЕРЫВАНИЯ.
Линии прерывания мест непосредственно связаны с кнтроллером прерывания INTEL
8259A. Контроллер прерывания будет реагировать на прерывания при переходе с
низкого уровня на высокий. На шине ISA отсутствуют линии подтверждения